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一种提升运行速度的FPGA芯片设计方法
本发明公开了一种提升运行速度的FPGA芯片设计方法,涉及FPGA技术领域,该方法在将RTL级描述文件转换成通用电路后,首先进行电路结构的拆分,再对划分得到的若干个子电路分别进行逻辑优化和器件映射得到每个子电路对应的子网表,然后基于各个子网表在全芯片上进行装箱布局布线最终完成芯片设计;该方法优化了FPGA芯片的设计流程,尤其是优化了逻辑综合过程,使得逻辑综合过程中不再针对电路规模较大的通用电路整体进行处理,而是分别处理多个小规模的电路结构,可以减少总体消耗时间,缩短FPGA的设计时长。
利用网表局部再综合实现布局合法化的FPGA布局方法
本发明公开了一种利用网表局部再综合实现布局合法化的FPGA布局方法,涉及FPGA技术领域,该方法在利用全局用户网表进行布局后,将布局结果不符合布局目标的区域选定为目标区域,根据当前的布局结果中位于目标区域内的实例确定当前的全局用户网表中的待优化功能模块,然后对待优化功能模块根据布局目标对应的优化目标重新进行逻辑综合处理并更新当前的全局布局网表重新布局,该方法对待优化功能模块单独重新进行逻辑综合,也即对全局用户网表进行增量式优化更新,可以使得目标区域尽快展开达成布局目标,而且可以减少每次处理量,从而提高布局过程中的局部区域展开效率,尽快达成布局目标。
一种基于智能分析的芯片设计方法
本发明公开了一种基于智能分析的芯片设计方法,涉及芯片设计技术领域,该方法对RTL级描述文件中的描述语句进行解析并识别得到若干个器件组,每个器件组是通过至少两个具有预定关联的描述语句和/或至少一个符合预定语句特征的描述语句表示的电路结构,将所有器件组加入包含若干个原型器件的映射库中,然后基于映射库进行逻辑综合处理得到逻辑网表并在待设计芯片上进行装箱、布局和布线,该方法由原型器件层级向更高层级的抽象和提升,从而可以减少处理单元数量和数据规模,而且可以最大限度地使用并行处理的计算资源,来提高超大容量芯片设计的处理能力和效率,而且可以帮助后续设计流程提高效率和品质。
文件生成方法、装置、电子设备及存储介质
本公开提供了一种文件生成方法、装置、电子设备及存储介质,该方法包括:获取当前芯片子系统的通用配置文件和针对不同芯片子系统的信息描述文件;通过解析所述通用配置文件,生成对所述当前芯片子系统进行低功耗设计的条件约束集合,所述条件约束集合用于指示不同低功耗设计阶段对于功耗意图描述文件的需求;以及,通过解析所述信息描述文件,生成对不同芯片子系统进行低功耗设计的功耗策略信息;基于所述条件约束集合和所述功耗策略信息,填充功耗意图文件的文件模板,生成功耗意图文件。

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