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基于人工智能的异构计算平台
本发明公开了一种基于人工智能的异构计算平台,包括底层异构硬件平台、系统软件层以及应用软件层,系统软件层运行在底层异构硬件平台上,应用软件层在系统软件层上开发应用。本发明基于人工智能实现了异构计算,采用双冗余交换开关式互连体系架构设计,支持动态扩展和并行处理的系统体系架构,包含硬件系统架构、软件平台设计和内部总线设计。通过增加冗余链路和故障检测电路,可以在单个计算模块或数据链路出现故障时,通过重新配置交换模块的节点转发表,对并行系统进行拓扑重构,使系统具备较强的容错性和故障隔离能力。
一种内嵌FPGA的众核架构及其数据处理方法
本发明公开了一种内嵌FPGA的众核架构及其数据处理方法,所述众核架构包括众核阵列,所述众核阵列包括多个计算核和至少一个集成FPGA的处理核,所述处理核与所述多个计算核设置同步时钟,所述处理核与其相邻的计算核通过核间路由进行通信,当前计算核的计算数据通过核间路由从计算核传输至至少一个处理核中的FPGA计算单元进行运算。本发明的有益效果为:通过在众核阵列中集成FPGA的处理核,处理核与其相邻的计算核通过核间路由进行通信,当前计算核的计算数据通过核间路由从计算核传输至至少一个处理核中的FPGA计算单元进行运算,节省了处理时间,提高了运算效率。
多线程数据处理方法、装置、终端及采集系统
本发明提供一种多线程数据处理方法、装置、终端及采集系统。该方法包括接收串行上传的多个数据集和结束符;结束符用于表明多个数据集已上传完成;在接收到结束符后,生成包含多个并行的子线程的主线程;每个数据集对应一个子线程,结束符对应一个子线程根据多个数据集生成参考数据标识集;参考数据标识集包括每个数据集的数据标识;生成目标数据标识集,目标数据标识集包括已被对应子线程处理完成的数据集的数据标识;在检测到目标数据标识集和参考数据标识集对应,且检测到结束符已被处理完成时,退出主线程。本发明能够提高多线程数据处理的可靠性。
一种基于5G小基站的MAC层调度方法及终端
本发明公开了一种基于5G小基站的MAC层调度方法及终端,根据每个上下行物理信道间的调度关系生成对应的调度事件,对于能够并发处理的调度事件配置到不同的线程中进行并发处理,将只能串行处理的调度事件配置在同一个线程中进行串行处理;将串行处理的线程进行延时处理时,将最耗时且不能并发处理的串行调度事件分配至多个线程中,通过类似多级流水线处理方式,将原来的处理过程拆分成执行时间相近的多个部分,由于比原先新增了多个线程进行延时处理,在接入大量用户设备后,在相同的时间内,调度的用户个数增加也会相应增加,因此能够在不改变CPU处理能力的情况下,提高小基站在每个调度时间内处理的移动设备数量,提升整体调度速率。
一种C64x+ DSP软件流水循环缓冲机制的模拟方法
本发明公开了一种C64x+DSP软件流水循环缓冲机制的模拟方法,该方法将软件流水循环缓冲的执行过程进行了抽象,将其设计为一个具有不同状态、阶段的二层状态机。首先,通过控制信息进行状态机的状态、阶段判断;然后,根据状态机的状态、阶段,选取并执行循环缓冲操作的序列组合,以实现循环缓冲运行时程序存储器和循环缓冲器的实际操作。最后,更新控制信息和状态机的状态、阶段,判断和处理普通流水线和中断的重启。本发明能够完成对于C64x+DSP软件流水循环缓冲机制的高效模拟,具有较好的应用前景。
一种基于异步单轨的流水线处理器
本申请涉及一种基于异步单轨的流水线处理器,包括:异步控制模块、取指模块、译码模块、执行模块、自适应选择模块、访存模块、写回模块、存储模块、控制和状态寄存器、通用寄存器,各个模块之间通过异步单轨握手完成数据通信,其中所述异步控制模块包含多个控制单元,所述多个控制单元为多个相位解耦Click单元,所述多个相位解耦Click单元通过握手相互级联,并分别与对应的流水线连接。通过本申请,解决了相关技术中流水线处理器功耗高、全局时钟偏移严重、时钟频率受限制速度慢的问题,实现了流水线在低功耗下无时钟以较高速度运行。
一种具有异构处理器的众核架构及其数据处理方法
本发明公开了一种具有异构处理器的众核架构及其数据处理方法,所述众核架构包括众核阵列,所述众核阵列包括多个计算核和至少一个与所述多个计算核功能不同的处理核,所述处理核与所述多个计算核设置同步时钟,所述处理核与其相邻的计算核通过核间路由进行通信,当前计算核的运算数据通过核间路由从当前计算核传输至至少一个与计算核功能不同的处理核进行计算。本发明的有益效果为:在众核阵列中增加集成FPGA的处理核、集成DSP的处理核,实现具有异构处理器的众核架构,使众核阵列能处理各种复杂逻辑控制和复杂科学计算,提高运算效率,降低能耗。

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